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[家电产品] 功率辐射的问题

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楼主
发表于 2007-7-6 08:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
广东安规检测
有限公司提供：
对于晶振上的干扰,' t/ C4 y0 p3 q+ k6 b+ E

' }7 m3 L9 s  g7 u在某一点上严重超标,是怎么解决的
) P- D5 j8 F5 ]1 s* s3 u, {4 P3 D, N5 |# [$ Z/ p6 H
谢谢
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沙发
发表于 2007-7-6 09:54 | 只看该作者
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
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板凳
 楼主| 发表于 2007-7-6 09:59 | 只看该作者
引用第2楼ds1983于2007-07-06 09:54发表的  :7 n. i1 |1 a8 ~% m3 w
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。

! U( [% Q/ _- M1 G  j是的,好象没有接地的2 i$ |1 b: G- T; ~/ g) g2 E
# |3 _1 M% e( B+ S/ O/ U( ^; ?
是客户的板,没有仔细看的
# M6 w0 d: N- E5 R8 w0 ^; u. q5 W  p# X
! z* Q! N  E. i9 L; z8 ?' j是11.0592M这样的晶振/ \) [+ |0 w" s: ~

5 f2 B# z- C+ s% q4 j5 v只有这一点是有问题的$ u, c; z+ `  T& `: U- p$ i4 \
8 w8 M* e5 A# A' L/ S
头痛啊
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mypcb
地板
发表于 2007-7-7 00:47 | 只看该作者
我的一点点经验，你可试试
& T; U* {, D, W2 I" L1。晶振外壳接地
$ z! r- o! [/ ]5 F" G; c" @2。在不影响性能的情况下关联电阻在两端，以降低其幅度
% w  x$ v+ G" _9 e' U+ J$ f) D$ J3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
  f* L9 n2 R& @! r- U4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
0 ?& D# q8 a% I5。在电源线上加CORE
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5#
 楼主| 发表于 2007-7-7 08:27 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
+ F/ W  A8 T# B3 Q5 i! r( u我的一点点经验，你可试试$ I% T+ C  P& q, g: ~
1。晶振外壳接地+ M, {( h$ r- u; H4 o: c
2。在不影响性能的情况下关联电阻在两端，以降低其幅度
4 c" W2 S9 l: f8 E3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
( E2 {  q$ ?' d& c# ?( _5 t4。还不行就将整个晶振上方用铜片包住接地进行屏蔽& g- y6 C, q( o6 h; \* Z
.......

6 c% q$ e/ m: S. c3 F7 j" D7 a$ z# |% c
謝謝，
  `% H) A9 w* X# {4 P  k/ ~0 N. h; E4 H( \* d
並聯電阻，一般是多大的呢？  I' r1 K+ y7 x* K2 B1 i

; l, F- U* X( S& b5 d) L. W電源線有加的，信號線也有加，25*12*15的
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6#
发表于 2007-7-8 10:05 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
/ y- K+ P8 r0 S1 W我的一点点经验，你可试试
2 s  V  Y) p% U% x- T) m: z; }  v3 u1。晶振外壳接地8 ?* y  k2 t- ]/ h* a& _/ d
2。在不影响性能的情况下关联电阻在两端，以降低其幅度* |* K! O3 b7 t* V2 B, I5 M( v
3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
+ H- c8 M  y. b4 i4。还不行就将整个晶振上方用铜片包住接地进行屏蔽/ _9 r7 v& H+ u4 ?9 R- E, o( n8 \
.......
哈哈！mypcb兄回来了！欢迎欢迎！以后还请多指教！
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CHDYZ
7#
发表于 2007-7-8 14:53 | 只看该作者
晶振外壳接地，接地的铜皮要比晶振的体积大，并且最好在接近电源处引此地线。另外很可能是布线引起的，并非晶振。
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mypcb
8#
发表于 2007-7-9 17:34 | 只看该作者
引用第5楼bamboolight于2007-07-07 08:27发表的  :
5 l7 W- a: n( A1 Q) U6 E: ^, m3 B/ H' m2 [& z" t

: a, p! ?' l, y; G, Y- c; r( Z& ?
8 E; z' U1 d# B4 x$ [謝謝，$ \; F# D$ m, g! q
2 T1 f* Z+ i+ u& f+ y
.......
  K# \' z; e' H/ h. U, z' w2 F

& K/ P. i" N  N  v1 ]可先并一个1M的试试,看会不会有所改善
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9#
发表于 2007-7-13 22:54 | 只看该作者
嗯，削减晶振的能量是一方面。另外，干扰是否可能由其他并排走的信号/控制线耦合而来？除了在电源线上加ferrite core，也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的，能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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