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[家电产品] 功率辐射的问题

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楼主
发表于 2007-7-6 08:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
广东安规检测
有限公司提供：
对于晶振上的干扰,5 v8 u2 t- H  N* Q; G  k, X

( j5 i2 |( ~; G* m. J% O在某一点上严重超标,是怎么解决的
; c5 H. d$ B# y: t* U
9 W- f4 K3 t  Q. }/ O; _0 V谢谢
广东安规生产电池设备、灼热丝、针焰、水平垂直燃烧机、漏电起痕试验机、恒温恒湿箱、高低温冲击箱、IP淋雨试验机、砂尘箱、灯头量规
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沙发
发表于 2007-7-6 09:54 | 只看该作者
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
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板凳
 楼主| 发表于 2007-7-6 09:59 | 只看该作者
引用第2楼ds1983于2007-07-06 09:54发表的  :( I7 K- b+ e! v; n  x  z* f! u
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
) q' ~7 n9 C; I- |
是的,好象没有接地的
8 i: A+ }' Y! s3 `, w7 L0 q* o$ H) z
是客户的板,没有仔细看的( k- Z  x3 i) G3 r+ I% }$ |
& }  ]+ e$ A+ h1 G  K- K* j
是11.0592M这样的晶振7 C, T7 ]; u0 S' E# N4 D0 A

& C% m' x- n+ D只有这一点是有问题的
! j! R' J( `5 y$ v
0 x, m5 T2 ~8 r8 T  q, e7 m2 A( m% D头痛啊
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mypcb
地板
发表于 2007-7-7 00:47 | 只看该作者
我的一点点经验，你可试试- A# w* J. B8 ^5 L, h
1。晶振外壳接地( l+ e& {2 ?9 p" P) f; U
2。在不影响性能的情况下关联电阻在两端，以降低其幅度' `0 h! i2 v$ M! e3 z) R$ k
3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致( ^6 |/ L+ r/ s7 p9 B: E& L( p
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
# k4 N4 N. n8 x# A. P5。在电源线上加CORE
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5#
 楼主| 发表于 2007-7-7 08:27 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :; E4 [1 V' i" B- S! }9 k8 k
我的一点点经验，你可试试
- W" C. G- c: ]0 E( N% n2 w1。晶振外壳接地; [: v4 {# Z$ {+ e9 u
2。在不影响性能的情况下关联电阻在两端，以降低其幅度
# X  n2 `8 K2 f) J3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
3 S0 {$ k1 `0 O" `6 ~% I9 \4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
" a5 K+ t4 F! _.......
& U  n# w4 _+ [; h- ^8 [' L; P/ r

9 R* u7 Q* ?0 @/ H  b0 S4 ?) n謝謝，
6 |5 s5 g: K5 I* r+ v* R2 n- _. m+ R( z! ?+ G' Q
並聯電阻，一般是多大的呢？' J+ V* @  ^/ m
! j, b7 f6 B7 \* X8 X
電源線有加的，信號線也有加，25*12*15的
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6#
发表于 2007-7-8 10:05 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
; I" H/ V0 p" a" U1 s' ?, C% H我的一点点经验，你可试试
& Z; G* M! v3 G; `3 G1。晶振外壳接地
7 _" K: B! E6 X- C" F# `2。在不影响性能的情况下关联电阻在两端，以降低其幅度' Q1 A& F1 p9 Z4 G/ ]+ P( U
3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致$ _1 R$ z& @. l$ V% i. H% O
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽2 b; M4 g; O, Q. k
.......
哈哈！mypcb兄回来了！欢迎欢迎！以后还请多指教！
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CHDYZ
7#
发表于 2007-7-8 14:53 | 只看该作者
晶振外壳接地，接地的铜皮要比晶振的体积大，并且最好在接近电源处引此地线。另外很可能是布线引起的，并非晶振。
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mypcb
8#
发表于 2007-7-9 17:34 | 只看该作者
引用第5楼bamboolight于2007-07-07 08:27发表的  :8 V6 K% O4 n/ e8 m

) V, X" S  N2 e5 S) h& ?6 \: Q2 q( Q
' D7 e5 q9 S& W1 v
謝謝，
+ n' j7 f8 T3 ]9 e+ i# Y+ c4 l* U; i
.......

9 g5 J* l9 K$ t, `; V. x9 ~0 {
- O& c% }2 s0 N1 t1 I3 i+ Q# p+ f5 I% d可先并一个1M的试试,看会不会有所改善
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9#
发表于 2007-7-13 22:54 | 只看该作者
嗯，削减晶振的能量是一方面。另外，干扰是否可能由其他并排走的信号/控制线耦合而来？除了在电源线上加ferrite core，也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的，能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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