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[家电产品] 功率辐射的问题

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楼主
发表于 2007-7-6 08:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
广东安规检测
有限公司提供：
对于晶振上的干扰,1 [1 [( T( }, }! m. J( b* ?
5 g& n! x& a' f3 F" K" w5 i( {
在某一点上严重超标,是怎么解决的, o' S( {; t4 h* `4 N

- X5 q- G8 r+ V! ^谢谢
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沙发
发表于 2007-7-6 09:54 | 只看该作者
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
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板凳
 楼主| 发表于 2007-7-6 09:59 | 只看该作者
引用第2楼ds1983于2007-07-06 09:54发表的  :. Y# w7 j: r7 X4 a4 I7 ]; [# m
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。

# U0 x) `/ _% Z# y是的,好象没有接地的  n, R/ {! m+ W+ S2 |

  ?8 Q4 t$ t# {* X5 m是客户的板,没有仔细看的  ?  I% ?- \0 o1 Y  C
/ g+ C0 i% L' Q2 g3 C
是11.0592M这样的晶振- n; t+ X: h1 |4 I7 m

& G1 j7 \* m8 w/ P  N只有这一点是有问题的
3 x/ F: N. _( S. i( |
8 s4 X( S0 t! j' a# ~. _头痛啊
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mypcb
地板
发表于 2007-7-7 00:47 | 只看该作者
我的一点点经验，你可试试; ~9 R5 s' K. D9 ?
1。晶振外壳接地
  ~" E- d, x' Q1 d, k2。在不影响性能的情况下关联电阻在两端，以降低其幅度
: R$ }6 d. ~: K. W# L3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致* _: Q) z; f( a6 @8 z: }9 l
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
1 @# T* [+ V. g- _2 z5。在电源线上加CORE
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5#
 楼主| 发表于 2007-7-7 08:27 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
( y9 A( |+ G) p" ?我的一点点经验，你可试试
( G9 [& b8 \2 t3 o8 X- A9 l$ _1。晶振外壳接地9 N4 u6 c. o, G+ N7 T8 U
2。在不影响性能的情况下关联电阻在两端，以降低其幅度
9 o" K: i4 I3 U2 a  W3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
7 C2 ?% c( I( t/ ?- H( O4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
1 F' B5 ]# l/ |1 W5 h.......

, Q. Q/ l" J7 o# J0 J! C8 W2 g0 }0 h4 w" U! i4 T
謝謝，
# d) e! ]9 Q, L- q  U2 k1 w& Z4 Z% @3 h- c1 s6 o8 I. _
並聯電阻，一般是多大的呢？
9 l( r* ^0 r( z4 r# h: f. W0 a7 J7 v( f1 g0 c' A4 y+ k. X0 U: _* m
電源線有加的，信號線也有加，25*12*15的
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6#
发表于 2007-7-8 10:05 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :: I; l0 P( a. ?# s  S, A
我的一点点经验，你可试试
( X, i$ ]' A( |% M1。晶振外壳接地7 E8 h! H' Y, @' y0 U' s- }
2。在不影响性能的情况下关联电阻在两端，以降低其幅度
+ v$ q9 V0 @# l* S) B3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
1 J$ `& a2 Z% b1 x% w4 C4。还不行就将整个晶振上方用铜片包住接地进行屏蔽# G3 f+ R: y: Y( q7 q2 H  y
.......
哈哈！mypcb兄回来了！欢迎欢迎！以后还请多指教！
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CHDYZ
7#
发表于 2007-7-8 14:53 | 只看该作者
晶振外壳接地，接地的铜皮要比晶振的体积大，并且最好在接近电源处引此地线。另外很可能是布线引起的，并非晶振。
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mypcb
8#
发表于 2007-7-9 17:34 | 只看该作者
引用第5楼bamboolight于2007-07-07 08:27发表的  :
6 \) C$ v& R5 s# ]+ n- V% P8 c* {* z# m% W3 ]  d5 ?4 [6 L4 W2 l3 H
, l$ ~: [5 o  x5 P  G

; q$ {- f9 H% M/ Z; r+ W! Y謝謝，# R; Q; ^. I" ~3 c$ `
7 A+ f* \+ |( ?
.......

2 J9 G# U' ~/ c5 c& P  p
4 B- n* }( o% P可先并一个1M的试试,看会不会有所改善
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9#
发表于 2007-7-13 22:54 | 只看该作者
嗯，削减晶振的能量是一方面。另外，干扰是否可能由其他并排走的信号/控制线耦合而来？除了在电源线上加ferrite core，也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的，能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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